Método para modelado de una memoria cache de datos de un procesador para simular el comportamiento de esa memoria cache de datos en la ejecución de un código software en una plataforma destino que comprenda dicho procesador. La simulación se realiza en una plataforma nativa que tiene un procesador diferente del mencionado anteriormente.
Patente Nacional
Número de solicitud: P201001284
Fecha solicitud: 30/09/2010
Número de concesión: ES2381961B2
Fecha de concesión: 31/05/2013